5V41068APGG Clock Buffer 450 MHz 2.5V LVDS 1:4 Clock Buffer Circuiti integrati IC
| IDT | |
| Categoria di prodotto: | Codificatori, decodificatori, multiplexatori e demultiplexatori |
| RoHS: | Dettagli |
| Dispositivi per la trasmissione di dati | |
| 2 Input | |
| 1 Produzione | |
| 3.135 V | |
| 3.465 V | |
| 0 C | |
| + 70 C | |
| SMD/SMT | |
| TSSOP-16 | |
| Tubo | |
| Marca: | IDT |
| Altezza: | 1 mm |
| Lungo: | 5 mm |
| Tipo di prodotto: | Codificatori, decodificatori, multiplexatori e demultiplexatori |
| Serie: | 5V41068A |
| Sottocategoria: | IC logici |
| Larghezza: | 4.4 mm |
| Parte # Alias: | IDT5V41068APGG 5V41068A |
| Peso unitario: | 0.006102 once |
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TIPO
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Descrizione
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|---|---|
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Categoria
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Status del prodotto
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Non utilizzato
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DigiKey programmabile
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Non verificato
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PLL
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- No, no.
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Scopo principale
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PCI Express (PCIe)
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Input
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HCSL
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Prodotto
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HCSL, LVDS
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Numero di circuiti
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1
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Rapporto - Input:Output
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2:1
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Differenza - Input:Output
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Sì/Sì
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Frequenza - Max
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200 MHz
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Voltaggio - Fornitura
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3.135V ~ 3.465V
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Temperatura di funzionamento
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0°C ~ 70°C
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Tipo di montaggio
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Montaggio superficiale
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Confezione / Cassa
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16-TSSOP (0,173", 4,40 mm di larghezza)
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Confezione del dispositivo del fornitore
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16-TSSOP
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Numero del prodotto di base
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Descrizione generale
TDescriptionL'IDT5V41068A è un multicora differenziale 2:1 per le applicazioni PCIExpress.
L'IDT5V41068A può scegliere tra:
1 di 2 differential HCSLinputs per guidare una singola coppia di uscita HCSL differenziale.
al LVDS.
Applicazioni raccomandate
• Clock muxing nelle applicazioni PCIe Gen2 e Gen3
ProdottoCaratteristiche
• coppia di uscita HCSL con differenziale di corrente in modalità 1 0.7V
Caratteristiche/benefici
• Basso jitter additivo; adatto per l'uso nei sistemi PCIe Gen2 e Gen3
• pacchetto TSSOP a 16 pin; piccole dimensioni della scheda
• Le uscite possono essere terminate su LVDS; possono azionare una più ampia varietà di dispositivi
• Pin di controllo OE; maggiore gestione dell'energia del sistema
• Disponibile nell'intervallo di temperatura industriale; supporta applicazioni integrate più esigenti
• Jitter additivo di ciclo in ciclo < 5 ps• Jitter additivo di fase (PCIe Gen3) < 0,2 ps
• Frequenza di funzionamento fino a 200 MHz
Informazioni relative all'applicazione
Capacitori di disaggregazione
Come per ogni circuito integrato a segnale misto ad alte prestazioni, l'IDT5V41068A deve essere isolato dall'alimentazione del sistema.
Per un funzionamento ottimale, i condensatori di decopplaggio di 0,01 μF devono essere collegati tra ciascuna
VDD e piano di terra PCB
